意大利阿托斯ATOS放大器發(fā)展歷史威斯特

1962年美國EG&G PARC(SIGNAL RECOVERY公司的前身) 的*臺鎖相放大器(Lock-in Amplifier，簡稱LIA)的發(fā)明，使微弱信號檢測技術(shù)得到標(biāo)志性的突破，極大地推動了基礎(chǔ)科學(xué)和工程技術(shù)的發(fā)展。目前，微弱信號檢測技術(shù)和儀器的不斷進(jìn)步，已經(jīng)在很多科學(xué)和技術(shù)領(lǐng)域中得到廣泛的應(yīng)用，未來科學(xué)研究不僅對微弱信號檢測技術(shù)提出更高的要求，同時新的科學(xué)技術(shù)發(fā)展反過來促進(jìn)了微弱信號檢測新原理和新方法的誕生。

早期的LIA是由模擬電路實現(xiàn)的，隨著數(shù)字技術(shù)的發(fā)展，出現(xiàn)了模擬與數(shù)字混合的LIA，這種LIA只是在信號輸入通道，參考信號通道和輸出通道采用了數(shù)字濾波器來抑制噪聲，或者在模擬鎖相放大器(簡稱ALIA)的基礎(chǔ)上多了一些模數(shù)轉(zhuǎn)換(ADC)、數(shù)模轉(zhuǎn)換(DAC)和各種通用數(shù)字接口功能，可以實現(xiàn)由計算機(jī)控制、監(jiān)視和顯示等輔助功能，但其核心相敏檢波器(PSD)或解調(diào)器仍是采用模擬電子技術(shù)實現(xiàn)的，本質(zhì)上也是ALIA。直到相敏檢波器或解調(diào)器用數(shù)字信號處理的方式實現(xiàn)后就出現(xiàn)了數(shù)字鎖相放大器(簡稱DLIA)，DLIA比ALIA有許多突出的優(yōu)點而倍受青睞，成為現(xiàn)在微弱信號檢測研究的熱點但是在一些特殊的場合中ALIA仍然發(fā)揮著DLIA不可替代的用。

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運算放大器是模數(shù)轉(zhuǎn)換電路中的一個zui通用、zui重要的的單元。全差分運放是指輸入和輸出都是差分信號的運放, 與普通的單端輸出運放相比有以下幾個優(yōu)點: 輸出的電壓擺幅較大;較好的抑制共模噪聲;更低的噪聲;抑制諧波失真的偶數(shù)階項比較好等。因此通常高性能的運放多采用全差分形式。近年來,全差分運放更高的單位增益帶寬頻率及更大的輸出擺幅使得它在高速和低壓電路中的應(yīng)用更加廣泛。隨著日益增加的數(shù)據(jù)轉(zhuǎn)換率, 高速的模數(shù)轉(zhuǎn)換器需求越來越廣泛, 而高速模數(shù)轉(zhuǎn)換器需要高增益和高單位增益帶寬運放來滿足系統(tǒng)精度和快速建立的需要。速度和精度是模擬電路兩個zui重要的性能指標(biāo),然而,這兩者的要求是互相制約、互為矛盾的。

所以同時滿足這兩方面的要求是困難的。折疊共源共柵技術(shù)可以較成功地解決這一難題, 這種結(jié)構(gòu)的運放具有較高的開環(huán)增益及很高的單位增益帶寬。全差分運放的缺點是它外部反饋環(huán)的共模環(huán)路增益很小, 輸出共模電平不能確定,因此,一般情況下需加共模反饋電路。運算放大器的結(jié)構(gòu)重要有三種:(a) 簡單兩級運放,(b)折疊共源共柵,(c)共源共柵,如圖1 的前級所示。本次設(shè)計的運算放大器的設(shè)計指標(biāo)要求差分輸出幅度為±4V, 即輸出端的所有NMOS 管的VDSAT,N 之和小于0.5V,輸出端的所有PMOS 管的VDSAT,P 之和也必須小于0.5V。該運算放大器存在兩級:(1)Cascode 級增大直流增益(M1-M8);(2)、共源放大器(M9-M12)。

對于全差分運放, 為了穩(wěn)定輸出共模電壓,應(yīng)加入共模負(fù)反饋電路。在設(shè)計輸出平衡的全差分運算放大器的時候,必須考慮到以下幾點:共模負(fù)反饋的開環(huán)直流增益要求足夠大,能夠于差分開環(huán)直流增益相當(dāng);共模負(fù)反饋的單位增益帶寬也要求足夠大,接近差分單位增益帶寬;為了確保共模負(fù)反饋的穩(wěn)定 一般情況下要求進(jìn)行共?；芈费a償共模信號監(jiān)測器要求具有很好的線性特性;共模負(fù)反饋與差模信號無關(guān),即使差模信號通路是的。

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